FPGA的洗衣机控制器设计芯片解密
VHDL 的英文全名是VHSIC Hardware Description Language(VHSIC硬件描述语言)。VHSIC是Very High Speed Integrated Circuit的缩写，是20世纪80年代在美国国防部的资助下始创的，并最终导致了VHDL语言的出现。1987年底，VHDL被 IEEE 和美国国防部确认为标准硬件描述语言。VHDL主要用于描述数字系统的结构，行为，功能和接口。除了含有许多具有硬件特征的语句外，VHDL的语言形式和描述风格与句法是十分类似于一般的计算机高级语言。VHDL的程序结构特点是将一项工程设计，或称设计实体（可以是一个元件，一个电路模块或一个系统）分成外部（或称可视部分，及端口）和内部（或称不可视部分），既涉及实体的内部功能和算法完成部分。在对一个设计实体定义了外部界面后，一旦其内部开发完成后，其他的设计就可以直接调用这个实体。这种将设计实体分成内外部分的概念是VHDL系统设计的基本点。
描述 在这个语言首次开发出来时，其目标仅是一个使电路文本化的一种标准，为了使人们采用文本方式描述的设计能够被其他人没有二意性地所理解。因为用自然语言描述电路会产生二意性。 这个模型是让人来阅读的。 模拟的模型 作为模型语言，用于采用模拟软件进行模拟。这个模型是让仿真软件来阅读的。 综合的模型 在自动设计系统中，作为设计输入。这个模型是让综合软件来阅读的。
VHDL 语言能够成为标准化的硬件描述语言并获得广泛应用，它自身必然具有很多其他硬件描述语言所不具备的优点。归纳起来，VHDL语言主要具有以下优点：
（1）VHDL 语言功能强大，设计方式多样
（2）VHDL 语言具有强大的硬件描述能力
（3）VHDL 语言具有很强的移植能力
（4）VHDL 语言的设计描述与器件无关
（5）VHDL 语言程序易于共享和复用
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1、设计一个电子定时器，控制洗衣机作如下运转：定时启动?正转?暂停?反转?暂停?定时未到回到“正转?暂停?……”，定时到则停止；
2、用两个数码管显示洗涤的预置时间（分钟数），按倒计时方式对洗涤过程作计时显示，直到时间到停机；洗涤过程由“开始”信号开始；
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由于洗衣机有工作时间，必须要一模块来控制它的工作时间范围，当洗衣机开
始工作后，减法计数器即会实现减数功能，直到时间减到零，洗衣机便停止工作。
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